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一種減少狀態數腓特比解碼器的積骿電路設計(ii)=ic design o...

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台灣大學電機工程學系

一種減少狀態數腓特比解碼器的積骿電路設計(ii)=ic design of a reduced-states viterbi decoder (ii)

Record Type:	Microfilm : monographic
Secondary Intellectual Responsibility:	林茂昭
Corporate Body:	台灣大學電機工程學系
Place of Publication:	台北市
Published:	科學技術資料中心;
Year of Publication:	1993
Description:	47頁 : 11x15公分;
Notes:	NSC82-0404-E002-225

一種減少狀態數腓特比解碼器的積骿電路設計(ii)=ic design of a reduced-states viterbi decoder (ii)
台灣大學電機工程學系

一種減少狀態數腓特比解碼器的積骿電路設計(ii)=ic design of a reduced-states viterbi decoder (ii) / 台灣大學電機工程學系 ; 林茂昭著 - 台北市 : 科學技術資料中心, 1993. - 47頁 ; 11x15公分.
NSC82-0404-E002-225.

林茂昭

一種減少狀態數腓特比解碼器的積骿電路設計(ii)=ic design of a reduced-states viterbi decoder (ii)
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