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邏輯寺成與可測性設計(交大vlsi-cad子計畫之二)=logic sy...
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國立交通大學電子工程研究所
邏輯寺成與可測性設計(交大vlsi-cad子計畫之二)=logic synthesis and design for testability
紀錄類型:
微縮資料 : 單行本
作者:
沈文仁
其他團體作者:
國立交通大學電子工程研究所
出版地:
台北市
出版者:
科學技術資料中心;
出版年:
1991
面頁冊數:
254頁 : 11x15公分;
附註:
NSC80-0404-E009-035
邏輯寺成與可測性設計(交大vlsi-cad子計畫之二)=logic synthesis and design for testability
沈文仁
邏輯寺成與可測性設計(交大vlsi-cad子計畫之二)=logic synthesis and design for testability
/ 沈文仁 著 ; 國立交通大學電子工程研究所 - 台北市 : 科學技術資料中心, 1991. - 254頁 ; 11x15公分.
NSC80-0404-E009-035.
邏輯寺成與可測性設計(交大vlsi-cad子計畫之二)=logic synthesis and design for testability
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19960723
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三樓視聽資料區
館藏
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1
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804448600000194
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